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低電平(Vil)指的是保證邏輯門(mén)的輸入為低電平時(shí)所允許的最大輸入低電平,當(dāng)輸入電平低于Vil時(shí),則認(rèn)為輸入電平為低電平。是與高電平相對(duì)的低電壓,是電子工程上的一種說(shuō)法。
低電平(Vil)指的是保證邏輯門(mén)的輸入為低電平時(shí)所允許的最大輸入低電平,當(dāng)輸入電平低于Vil時(shí),則認(rèn)為輸入電平為低電平。是與高電平相對(duì)的低電壓,是電子工程上的一種說(shuō)法。收起
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