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使用異步FIFO同步源自不同時鐘域的數(shù)據(jù)是在數(shù)字IC設(shè)計中經(jīng)常使用的方法。在異步FIFO中，讀指針在讀時鐘域，寫指針在寫時鐘域，所以不能單獨運用一個計數(shù)器去產(chǎn)生空滿信號了。因此，須要將寫指針同步到讀時鐘域去產(chǎn)生空信號，將讀指針同步到寫時鐘域去產(chǎn)生滿信號。

志芯

8088

03/27 08:57

數(shù)字ic設(shè)計時序約束

數(shù)字IC中后端設(shè)計中的“三化”升維

做數(shù)字IC中后端設(shè)計一定年限后，如何拓展技能的廣度和深度呢，將自己的思考總結(jié)為“三化”，就是“流程自動化”，“局部整體化”，“數(shù)字模擬化”。中的“三化”升維

志芯

2615

02/20 09:50

數(shù)字ic設(shè)計數(shù)字IC

Vim的基本使用方法

Vim是做數(shù)字IC設(shè)計、驗證最流行的編輯器，沒有之一。下面介紹一下基本使用方法。

陳鋒

2165

02/07 09:30

數(shù)字ic設(shè)計 Vim

復(fù)雜大規(guī)模數(shù)字芯片設(shè)計，迎來簡單“解題思路”

時間來到2024年，Chiplet勁頭不減。MIT科技評論將其列為2024年的十大突破性技術(shù)之一；中國新推出的《芯粒間互聯(lián)通信協(xié)議》標(biāo)準(zhǔn)從1月1日起開始實施；Intel在近日CES上也推出了其第一個Chiplet汽車SoC平臺，將AI PC帶入到了智能汽車中。

TechSugar

2737

01/18 11:20

芯片設(shè)計 chiplet

數(shù)字IC設(shè)計中的update io clock latency

本文基于innovus工具討論?；赽lock level的設(shè)計進行時序分析，如果在SDC和flow腳本中對clock 沒有設(shè)置source clock latency 和network ?clock latency，在ccopt之前clock模式是ideal的，所有的clock latency都是按照0計算。

志芯

5492

01/17 12:20

數(shù)字ic設(shè)計

數(shù)字IC設(shè)計中的分段時鐘樹綜合

為什么需要分段去做時鐘樹呢？因為在某些情況下，按照傳統(tǒng)的方法讓每一個clock group單獨去balance，如果不做額外干預(yù)，時鐘樹天然是做不平的。

志芯

5829

2023/12/01

ic設(shè)計數(shù)字ic設(shè)計

數(shù)字IC設(shè)計工程師成長四階段是怎樣的？

《中國集成電路產(chǎn)業(yè)人才發(fā)展報告》是業(yè)內(nèi)和IC設(shè)計、IC人才都息息相關(guān)的一份報告。從報告數(shù)據(jù)來看，無在半導(dǎo)體產(chǎn)業(yè)的哪個環(huán)節(jié)，個人發(fā)展路徑和年薪待遇都是逐級攀升的趨勢。那么從小白助理級，到總監(jiān)專家級，到底要經(jīng)歷怎樣的成長階段呢？

IC修真院

2703

2023/11/14

ic設(shè)計芯片工程師

后端設(shè)計是個啥？

最近的私信咨詢里，很多同學(xué)分不清數(shù)字IC設(shè)計前端和后端的區(qū)別，前端設(shè)計似乎很容易理解，簡單來說就是敲代碼的，只不過沒有用C++和python，用的是硬件描述語言Verilog。

IC修真院

1297

2022/01/21

工程師數(shù)字ic設(shè)計

招聘 | 小米數(shù)字IC筆試題及答案解析(二)

除法器的Verilog RTL實現(xiàn)。16bitA，8bitB。C=A/B （15分）；除法器的Verilog RTL實現(xiàn)。16bitA，8bitB。C=A/B （15分）；簡要描述AHB總線協(xié)議。包括有哪些信號，簡要描述信號的作用（15分）