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[摘要]
納米設(shè)計(jì)的復(fù)雜性日益增加,加上先進(jìn)制造工藝產(chǎn)生的新影響,給努力實(shí)現(xiàn)流片的設(shè)計(jì)工程師構(gòu)成了雙重威脅。要同時(shí)提供 FinFET 等詳細(xì) 3D 結(jié)構(gòu)必不可少的寄生參數(shù)提取精度,以及實(shí)現(xiàn)全芯片設(shè)計(jì)(在多個(gè)不同布線層上具有成百上千萬(wàn)個(gè)網(wǎng)絡(luò))快速