名稱:波形發(fā)生器DA輸出模擬信號Verilog代碼Quartus仿真
軟件:Quartus
語言:Verilog
代碼功能:
波形發(fā)生器DA輸出模擬信號
1、設計波形發(fā)生器,輸出的波形通過DA芯片輸出模擬信號。
3、可通過按鍵控制頻率加、減。
FPGA代碼Verilog/VHDL代碼資源下載:www.hdlcode.com
演示視頻:
設計文檔:
1. 工程文件
2. 程序文件
3. 程序編譯
4. RTL圖
5. 管腳分配
6. 仿真圖
整體仿真圖
按鍵消抖模塊
按鍵下降沿檢測模塊
控制頻率模塊
相位累加器
波形類型控制模塊
部分代碼展示:
//波形類型控制模塊 module?wave_control( ????input?clk_in,//50MHz input?rst,//復位,低電平復位 input?wave_change,//波形切換 ????input?[13:0]?wave_fb,//方波波形 ????input?[13:0]?wave_sj,//三角波形 ????input?[13:0]?wave_sin,?//正弦波形?? ????output?reg?[13:0]?DATA//輸出波形? ); reg?[1:0]?mode;//模式信號,01對應正弦波,10對應三角波,11對應方波 always@(posedge?clk_in?or?negedge?rst) if(rst==0)//復位 mode<=2'b01;//正弦波 else if(wave_change==1)begin//波形切換 if(mode==2'b01) mode<=2'b10;//10對應三角波 else?if(mode==2'b10) mode<=2'b11;//11對應方波 else?if(mode==2'b11) mode<=2'b01;//01對應正弦波 else mode<=2'b01;//正弦波 end else mode<=mode; //3選1;01對應正弦波,10對應三角波,11對應方波 always@(posedge?clk_in) ????case(mode) ????????2'b01:DATA<=wave_sin; ????????2'b10:DATA<=wave_sj; ????????2'b11:DATA<=wave_fb; ????????default:DATA<=14'd0; ????endcase endmodule
點擊鏈接獲取代碼文件:http://www.hdlcode.com/index.php?m=home&c=View&a=index&aid=562
閱讀全文